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32 Mbit Multi-Purpose Flash Plus
SST39VF3201B / SST39VF3202B
Data Sheet
ADDRESS A MS-0
CE#
OE#
T RC
T CE
T OE
T AA
WE#
V IH
T OLZ
T OHZ
T CLZ
T OH
T CHZ
DQ 15-0
HIGH-Z
DATA VALID
DATA VALID
HIGH-Z
1384 F03.0
Note: A MS = Most significant address
A MS = A 20 for SST39VF320xB
FIGURE 5: Read Cycle Timing Diagram
INTERNAL PROGRAM OPERATION STARTS
T BP
ADDRESS A MS-0
555
2AA
555
ADDR
WE#
T AH
T WP
T DH
T AS
T WPH
T DS
OE#
T CH
CE#
T CS
DQ 15-0
XXAA
SW0
XX55
SW1
XXA0
SW2
DATA
WORD
(ADDR/DATA)
1384 F04.0
Note: A MS = Most significant address
A MS = A 20 for SST39VF320xB
WP# must be held in proper logic state (V IL or V IH ) 1 μs prior to and 1 μs after the command sequence.
X can be V IL or V IH, but no other value.
FIGURE 6: WE# Controlled Program Cycle Timing Diagram
?2009 Silicon Storage Technology, Inc.
14
S71384-01-000
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